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The advanced design flow for Nanometer analog applications

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坚持小班授课，为保证培训效果，增加互动环节，每期人数限3到5人。注意：本课程一旦开课不予退费。

时间地点

上课地点：【上海】：同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【深圳分部】：电影大厦(地铁一号线大剧院站)/深圳大学成教院【北京分部】：北京中山/福鑫大楼【南京分部】：金港大厦(和燕路) 【武汉分部】：佳源大厦（高新二路）【成都分部】：领馆区1号（中和大道）【沈阳分部】：沈阳理工大学/六宅臻品【郑州分部】：郑州大学/锦华大厦【石家庄分部】：河北科技大学/瑞景大厦【广州分部】：广粮大厦【西安分部】：协同大厦
近开课时间(周末班/连续班/晚班）：Nanometer培训班：2024年11月18日......(欢迎您垂询，视教育质量为生命！)

学时和费用

        ★课时：请咨询在线客服

         ☆注重质量 ☆边讲边练
        ☆合格学员免费推荐工作
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新优惠

◆在读学生凭学生证，可优惠500元。

质量保障

        1、培训过程中，如有部分内容理解不透或消化不好，可免费在以后培训班中重听；
        2、课程完成后,授课老师留给学员手机和Email,保障培训效果,免费提供半年的技术支持。
        3、培训合格学员可享受免费推荐就业机会。

课程大纲:

The advanced design flow for Nanometer analog applications

课程内容：

1． Cadence Virtuoso平台介绍

2．? 定制数字和模拟集成电路的设计环境及数据需求介绍

3．? 基于上机操作的电路原理图输入

4．? 模拟设计环境的熟悉

5．? Spectre电路仿真器的基本使用方法和技巧

6．? 快速仿真器UltraSim的使用方法其性能体验

7．? VSdE仿真环境的熟悉，练习设计规范的定义

8．? 在及时完成的一天内容的前提下，进入定制电路设计的后端内容

9．? 连接驱动的自动版图生成技术

10．? 实时的DRC检查能力

11．? Assura DRC/LVS物理验证技术

12．? 定制数字和模拟电路的自动布线

13．? 寄生参数提取

14．? 寄生参数的反标和后版图验证流程

15．? Hierarchical Editor在后仿真验证中的应用

16．? Stream Out