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  Mentor FPGA设计培训
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       坚持小班授课,为保证培训效果,增加互动环节,每期人数限3到5人。
   上课时间和地点
上课地点:【上海】:同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【深圳分部】:电影大厦(地铁一号线大剧院站)/深圳大学成教院 【北京分部】:北京中山/福鑫大楼 【南京分部】:金港大厦(和燕路) 【武汉分部】:佳源大厦(高新二路) 【成都分部】:领馆区1号(中和大道) 【沈阳分部】:沈阳理工大学/六宅臻品 【郑州分部】:郑州大学/锦华大厦 【石家庄分部】:河北科技大学/瑞景大厦 【广州分部】:广粮大厦 【西安分部】:协同大厦
近开课时间(周末班/连续班/晚班)
Mentor FPGA设计培训:2024年11月18日......(欢迎您垂询,视教育质量为生命!)
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        1、培训过程中,如有部分内容理解不透或消化不好,可免费在以后培训班中重听;
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  Mentor FPGA设计培训
培训方式以讲课和实验穿插进行

课程描述:

课程简介

Mentor Graphics是业界唯一拥有FPGA全流程设计工具的EDA厂家,本课程将帮您获得熟练使用FPGA Advantage所需的众多技巧,提高您的FPGA设计方法。本课程会讲解如何创建特定的设计,从概念一直到芯片。大量的讲解模块将演示FPGA Advantage的完整设计流程,从HDL Desinger Series里创建一个基本的图形化设计,通过Modelsim HDL仿真器来验证您的设计,再用Precision Synthesis把您的设计综合优化到一个物理器件上。在业界专家的指导下,手把手的练习将进一步巩固授课内容并为您奉献广泛的工具使用经验。

课程目的

     借助HDL Designer Series快速建立HDL设计概念;

     构建HDL状态机,方框图,真值表,流程图;

     用Modelsim调试验证您的概念设计;

     快速创建测试基准;

     用Precision把HDL设计综合到广泛的FPGA物理器件中;?

     针对速度和面积优化设计;

     有效地运用层次化设计;

     执行静态时序分析;

     运用Top-down和Bottom-up设计技术;

     设计单元复用;

     利用高级的交互窗口能力支持调试;

     使用调试分析功能;

     创建和比较多个结果波形;





课程对象

   FPGA/ASIC设计工程师;

   CAD工程师和负责把FPGA Advantage集成到设计流程中的管理人员;

   负责提高FPGA设计效率的CAD支持团队成员;

   运用VHDL、Verilog或mixed-HDL进行仿真和分析的硬件、软件及系统